182.696 Hardware Modeling
Diese Lehrveranstaltung ist in allen zugeordneten Curricula Teil der STEOP.
Diese Lehrveranstaltung ist in mindestens einem zugeordneten Curriculum Teil der STEOP.

2019S, VO, 1.5h, 1.5EC, wird geblockt abgehalten
TUWEL

Merkmale

  • Semesterwochenstunden: 1.5
  • ECTS: 1.5
  • Typ: VO Vorlesung

Ziele der Lehrveranstaltung

AbsolventInnen der LVA können

  • die Unterschiede zwischen Software- und Hardware-Entwicklung benennen
  • grundlegende VHDL Sprachkonstrukte und -konzepte benutzen
  • das Verhalten von in VHDL spezifizierten Hardware Modulen darstellen
  • aus einer textuellen Beschreibung Hardware Module mit internem Zustand entwickeln
  • ein simples Hardware-Design mittels der Hardwarebeschreibungssprache VHDL implementieren
  • den Entwurfsweg eines vernünftigen Implementierungsstrategie beschreiben
  • Lösungen zu Problemen, die in realen Schaltungen auftreten, diskuttieren
  • den Tool Design Flow und Mechanismen die diesen kontrollieren beschreiben
  • die einzelnen Schritte der Verifikation beschreiben

Inhalt der Lehrveranstaltung

Hardware Entwicklung

  • Motivation und Einführung
  • wichtige Eigenschaften und die Unterschiede zur Software Entwicklung
  • Herausforderungen und Beschreibungssprachen

VHDL

  • Entity, Architecture und Configuration
  • structural und behavioral Programmierung
  • Testbenches, Components und Packages
  • Process, Sensitivity List und Control Flow Anweisungen
  • State Machines, Drei Prozess Methode
  • Datentypen, Attribute, Bibliotheken, Subprogramme, ...

Hardware-Modellierung

  • Design Flow inkl. Verifikation
  • Spezifikation, Partitionierung und Designbeschreibung
  • Handhabung realer Probleme in der Praxis
  • State Machine Design
  • Programmierung in Hinblick auf Wiederverwendbarkeit
  • Synthese und Optimierung
  • Funktionale/Formal Verifikation, automatisiertes Testen

Tools

  • Quartus (Synthese)
  • Modelsim (Verifikation)

Weitere Informationen

  • Mitschnitte (Slides + Audio) nach der Vorlesung in TUWEL verfügbar
  • benötigte Tools werden in der Vorlesung vorgestellt

ECTS Breakdown

16 h    Anwesenheit in der Vorlesung
21.5 h Laufende Beschäftigung mit dem aktuellen Stoff der VO + Vorbereitung auf die Prüfung
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37.5h  (= 1.5 ECTS)

ACHTUNG: Am 20.3. und 3.4. entfällt die Vorlesung!

Vortragende Personen

Institut

LVA Termine

TagZeitDatumOrtBeschreibung
Mi.09:00 - 11:0006.03.2019 - 27.03.2019HS 17 Friedrich Hartmann - ARCH HW Modeling VO
Fr.13:00 - 15:0008.03.2019 - 05.04.2019EI 8 Pötzl HS - QUER HW Modeling VO
Hardware Modeling - Einzeltermine
TagDatumZeitOrtBeschreibung
Mi.06.03.201909:00 - 11:00HS 17 Friedrich Hartmann - ARCH HW Modeling VO
Fr.08.03.201913:00 - 15:00EI 8 Pötzl HS - QUER HW Modeling VO
Mi.13.03.201909:00 - 11:00HS 17 Friedrich Hartmann - ARCH HW Modeling VO
Fr.15.03.201913:00 - 15:00EI 8 Pötzl HS - QUER HW Modeling VO
Fr.22.03.201913:00 - 15:00EI 8 Pötzl HS - QUER HW Modeling VO
Mi.27.03.201909:00 - 11:00HS 17 Friedrich Hartmann - ARCH HW Modeling VO
Fr.29.03.201913:00 - 15:00EI 8 Pötzl HS - QUER HW Modeling VO
Fr.05.04.201913:00 - 15:00EI 8 Pötzl HS - QUER HW Modeling VO
LVA wird geblockt abgehalten

Leistungsnachweis

schriftliche Prüfung auf Papier, Cheat Sheet (siehe TUWEL) wird zur Verfügung gestellt

LVA-Anmeldung

Von Bis Abmeldung bis
18.02.2019 00:00 31.03.2019 23:59

Curricula

StudienkennzahlVerbindlichkeitSemesterAnm.Bed.Info
033 535 Technische Informatik Pflichtfach4. SemesterSTEOP
Lehrveranstaltung erfordert die Erfüllung der Studieneingangs- und Orientierungsphase STEOP

Literatur

Folien, Audiomitschnitte, Literaturreferenzne und Beispiele zum Üben stehen im TUWEL Kurs zur Verfügung

Vorkenntnisse

  • Logikzellen (OR, MUX, FF, etc.)
  • Mealy / Moore Automaten
  • Y-Diagramm
  • Control Flow Konzepte (if-then-else, loops, etc.)
  • Synchrones Schaltungsdesign
  • Hardware Design Flow inklusive Verifikation

Vorausgehende Lehrveranstaltungen

Begleitende Lehrveranstaltungen

Vertiefende Lehrveranstaltungen

Weitere Informationen

Sprache

Englisch